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[all …]
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Dsim-dup-16b-2opimm-trace-aarch64.h38 0x33, 0x33, 0x33, 0x33, 0x33, 0x33, 0x33, 0x33, 0x33, 0x33, 0x33, 0x33, 0x33, 0x33, 0x33, 0x33,
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6 bne %xcc, .BB0
8 ! CHECK: be %xcc, .BB0 ! encoding: [0x02,0b01101AAA,A,A]
9 ! CHECK-NEXT: ! fixup A - offset: 0, value: .BB0, kind: fixup_sparc_br19
10 be %xcc, .BB0
12 ! CHECK: bg %xcc, .BB0 ! encoding: [0x14,0b01101AAA,A,A]
13 ! CHECK-NEXT: ! fixup A - offset: 0, value: .BB0, kind: fixup_sparc_br19
14 bg %xcc, .BB0
16 ! CHECK: ble %xcc, .BB0 ! encoding: [0x04,0b01101AAA,A,A]
[all …]
/external/llvm/test/MC/Sparc/
Dsparc-v9-traps.s3 ! CHECK: ta %icc, %i5 ! encoding: [0x91,0xd0,0x00,0x1d]
4 ! CHECK: ta %icc, 82 ! encoding: [0x91,0xd0,0x20,0x52]
5 ! CHECK: ta %icc, %g1 + %i2 ! encoding: [0x91,0xd0,0x40,0x1a]
6 ! CHECK: ta %icc, %i5 + 41 ! encoding: [0x91,0xd7,0x60,0x29]
12 ! CHECK: tn %icc, %i5 ! encoding: [0x81,0xd0,0x00,0x1d]
13 ! CHECK: tn %icc, 82 ! encoding: [0x81,0xd0,0x20,0x52]
14 ! CHECK: tn %icc, %g1 + %i2 ! encoding: [0x81,0xd0,0x40,0x1a]
15 ! CHECK: tn %icc, %i5 + 41 ! encoding: [0x81,0xd7,0x60,0x29]
21 ! CHECK: tne %icc, %i5 ! encoding: [0x93,0xd0,0x00,0x1d]
23 ! CHECK: tne %icc, %i5 ! encoding: [0x93,0xd0,0x00,0x1d]
[all …]
Dsparc64-ctrl-instructions.s4 ! CHECK: bne %xcc, .BB0 ! encoding: [0x12,0b01101AAA,A,A]
5 ! CHECK-NEXT: ! fixup A - offset: 0, value: .BB0, kind: fixup_sparc_br19
6 bne %xcc, .BB0
8 ! CHECK: be %xcc, .BB0 ! encoding: [0x02,0b01101AAA,A,A]
9 ! CHECK-NEXT: ! fixup A - offset: 0, value: .BB0, kind: fixup_sparc_br19
10 be %xcc, .BB0
12 ! CHECK: bg %xcc, .BB0 ! encoding: [0x14,0b01101AAA,A,A]
13 ! CHECK-NEXT: ! fixup A - offset: 0, value: .BB0, kind: fixup_sparc_br19
14 bg %xcc, .BB0
16 ! CHECK: ble %xcc, .BB0 ! encoding: [0x04,0b01101AAA,A,A]
[all …]
/external/llvm-project/llvm/test/MC/Disassembler/AMDGPU/
Dliteralv216_gfx10.txt7 # GFX10: v_pk_add_f16 v1, 0, v2 ; encoding: [0x01,0x00,0x0f,0xcc,0x80,0x04,0x02,0x18]
8 0x01,0x00,0x0f,0xcc,0x80,0x04,0x02,0x18
10 # GFX10: v_pk_add_f16 v1, v2, 0 ; encoding: [0x01,0x00,0x0f,0xcc,0x02,0x01,0x01,0x18]
11 0x01,0x00,0x0f,0xcc,0x02,0x01,0x01,0x18
13 # GFX10: v_pk_add_f16 v1, 1.0, v2 ; encoding: [0x01,0x00,0x0f,0xcc,0xf2,0x04,0x02,0x18]
14 0x01,0x00,0x0f,0xcc,0xf2,0x04,0x02,0x18
16 # GFX10: v_pk_add_f16 v1, -1.0, v2 ; encoding: [0x01,0x00,0x0f,0xcc,0xf3,0x04,0x02,0x18]
17 0x01,0x00,0x0f,0xcc,0xf3,0x04,0x02,0x18
19 # GFX10: v_pk_add_f16 v1, -0.5, v2 ; encoding: [0x01,0x00,0x0f,0xcc,0xf1,0x04,0x02,0x18]
20 0x01,0x00,0x0f,0xcc,0xf1,0x04,0x02,0x18
[all …]
/external/capstone/suite/MC/AArch64/
Dgicv3-regs.s.cs1 # CS_ARCH_ARM64, 0, None
2 0x08,0xcc,0x38,0xd5 = mrs x8, icc_iar1_el1
3 0x1a,0xc8,0x38,0xd5 = mrs x26, icc_iar0_el1
4 0x42,0xcc,0x38,0xd5 = mrs x2, icc_hppir1_el1
5 0x51,0xc8,0x38,0xd5 = mrs x17, icc_hppir0_el1
6 0x7d,0xcb,0x38,0xd5 = mrs x29, icc_rpr_el1
7 0x24,0xcb,0x3c,0xd5 = mrs x4, ich_vtr_el2
8 0x78,0xcb,0x3c,0xd5 = mrs x24, ich_eisr_el2
9 0xa9,0xcb,0x3c,0xd5 = mrs x9, ich_elsr_el2
10 0x78,0xcc,0x38,0xd5 = mrs x24, icc_bpr1_el1
[all …]
/external/llvm-project/llvm/test/MC/Disassembler/AArch64/
Dgicv3-regs.txt4 0x8 0xcc 0x38 0xd5
6 0x1a 0xc8 0x38 0xd5
8 0x42 0xcc 0x38 0xd5
10 0x51 0xc8 0x38 0xd5
12 0x7d 0xcb 0x38 0xd5
14 0x24 0xcb 0x3c 0xd5
16 0x78 0xcb 0x3c 0xd5
18 0xa9 0xcb 0x3c 0xd5
20 0x78 0xcc 0x38 0xd5
22 0x6e 0xc8 0x38 0xd5
[all …]
/external/llvm/test/MC/Disassembler/Sparc/
Dsparc-v9.txt4 0x85 0x70 0x00 0x01
7 0x91 0xd0 0x00 0x1d
10 0x91 0xd0 0x20 0x52
13 0x91 0xd0 0x40 0x1a
16 0x91 0xd7 0x60 0x29
19 0x81 0xd0 0x00 0x1d
22 0x93 0xd0 0x20 0x52
25 0x83 0xd0 0x40 0x1a
28 0x95 0xd7 0x60 0x29
31 0x85 0xd0 0x00 0x1d
[all …]

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