/external/vixl/test/aarch32/traces/ |
D | assembler-cond-rd-operand-rn-shift-amount-1to31-tst-t32.h | 38 0x1e, 0xea, 0x78, 0x5f // tst al r14 r8 ROR 21 41 0x15, 0xea, 0x3d, 0x1f // tst al r5 r13 ROR 4 44 0x10, 0xea, 0x33, 0x1f // tst al r0 r3 ROR 4 47 0x13, 0xea, 0xfe, 0x1f // tst al r3 r14 ROR 7 50 0x12, 0xea, 0x86, 0x7f // tst al r2 r6 LSL 30 53 0x1b, 0xea, 0x84, 0x6f // tst al r11 r4 LSL 26 56 0x17, 0xea, 0x80, 0x7f // tst al r7 r0 LSL 30 59 0x10, 0xea, 0x79, 0x4f // tst al r0 r9 ROR 17 62 0x1b, 0xea, 0xf3, 0x7f // tst al r11 r3 ROR 31 65 0x18, 0xea, 0x38, 0x5f // tst al r8 r8 ROR 20 [all …]
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D | assembler-cond-rd-operand-rn-shift-amount-1to31-teq-t32.h | 38 0x9e, 0xea, 0x78, 0x5f // teq al r14 r8 ROR 21 41 0x95, 0xea, 0x3d, 0x1f // teq al r5 r13 ROR 4 44 0x90, 0xea, 0x33, 0x1f // teq al r0 r3 ROR 4 47 0x93, 0xea, 0xfe, 0x1f // teq al r3 r14 ROR 7 50 0x92, 0xea, 0x86, 0x7f // teq al r2 r6 LSL 30 53 0x9b, 0xea, 0x84, 0x6f // teq al r11 r4 LSL 26 56 0x97, 0xea, 0x80, 0x7f // teq al r7 r0 LSL 30 59 0x90, 0xea, 0x79, 0x4f // teq al r0 r9 ROR 17 62 0x9b, 0xea, 0xf3, 0x7f // teq al r11 r3 ROR 31 65 0x98, 0xea, 0x38, 0x5f // teq al r8 r8 ROR 20 [all …]
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D | assembler-cond-rd-operand-rn-shift-amount-1to31-mvns-t32.h | 38 0x7f, 0xea, 0x78, 0x5e // mvns al r14 r8 ROR 21 41 0x7f, 0xea, 0x3d, 0x15 // mvns al r5 r13 ROR 4 44 0x7f, 0xea, 0x33, 0x10 // mvns al r0 r3 ROR 4 47 0x7f, 0xea, 0xfe, 0x13 // mvns al r3 r14 ROR 7 50 0x7f, 0xea, 0x86, 0x72 // mvns al r2 r6 LSL 30 53 0x7f, 0xea, 0x84, 0x6b // mvns al r11 r4 LSL 26 56 0x7f, 0xea, 0x80, 0x77 // mvns al r7 r0 LSL 30 59 0x7f, 0xea, 0x79, 0x40 // mvns al r0 r9 ROR 17 62 0x7f, 0xea, 0xf3, 0x7b // mvns al r11 r3 ROR 31 65 0x7f, 0xea, 0x38, 0x58 // mvns al r8 r8 ROR 20 [all …]
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D | assembler-cond-rd-operand-rn-shift-amount-1to31-mvn-t32.h | 38 0x6f, 0xea, 0x78, 0x5e // mvn al r14 r8 ROR 21 41 0x6f, 0xea, 0x3d, 0x15 // mvn al r5 r13 ROR 4 44 0x6f, 0xea, 0x33, 0x10 // mvn al r0 r3 ROR 4 47 0x6f, 0xea, 0xfe, 0x13 // mvn al r3 r14 ROR 7 50 0x6f, 0xea, 0x86, 0x72 // mvn al r2 r6 LSL 30 53 0x6f, 0xea, 0x84, 0x6b // mvn al r11 r4 LSL 26 56 0x6f, 0xea, 0x80, 0x77 // mvn al r7 r0 LSL 30 59 0x6f, 0xea, 0x79, 0x40 // mvn al r0 r9 ROR 17 62 0x6f, 0xea, 0xf3, 0x7b // mvn al r11 r3 ROR 31 65 0x6f, 0xea, 0x38, 0x58 // mvn al r8 r8 ROR 20 [all …]
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D | assembler-cond-rd-operand-rn-shift-amount-1to31-mov-t32.h | 38 0x4f, 0xea, 0x78, 0x5e // mov al r14 r8 ROR 21 41 0x4f, 0xea, 0x3d, 0x15 // mov al r5 r13 ROR 4 44 0x4f, 0xea, 0x33, 0x10 // mov al r0 r3 ROR 4 47 0x4f, 0xea, 0xfe, 0x13 // mov al r3 r14 ROR 7 50 0x4f, 0xea, 0x86, 0x72 // mov al r2 r6 LSL 30 53 0x4f, 0xea, 0x84, 0x6b // mov al r11 r4 LSL 26 56 0x4f, 0xea, 0x80, 0x77 // mov al r7 r0 LSL 30 59 0x4f, 0xea, 0x79, 0x40 // mov al r0 r9 ROR 17 62 0x4f, 0xea, 0xf3, 0x7b // mov al r11 r3 ROR 31 65 0x4f, 0xea, 0x38, 0x58 // mov al r8 r8 ROR 20 [all …]
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D | assembler-cond-rd-operand-rn-shift-amount-1to32-mvns-t32.h | 38 0x7f, 0xea, 0x57, 0x17 // mvns al r7 r7 LSR 5 41 0x7f, 0xea, 0xa3, 0x70 // mvns al r0 r3 ASR 30 44 0x7f, 0xea, 0xe5, 0x7a // mvns al r10 r5 ASR 31 47 0x7f, 0xea, 0x29, 0x4c // mvns al r12 r9 ASR 16 50 0x7f, 0xea, 0xe3, 0x75 // mvns al r5 r3 ASR 31 53 0x7f, 0xea, 0xa8, 0x2a // mvns al r10 r8 ASR 10 56 0x7f, 0xea, 0xd7, 0x26 // mvns al r6 r7 LSR 11 59 0x7f, 0xea, 0xec, 0x7d // mvns al r13 r12 ASR 31 62 0x7f, 0xea, 0xa0, 0x54 // mvns al r4 r0 ASR 22 65 0x7f, 0xea, 0xea, 0x53 // mvns al r3 r10 ASR 23 [all …]
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D | assembler-cond-rd-operand-rn-shift-amount-1to32-mvn-t32.h | 38 0x6f, 0xea, 0x57, 0x17 // mvn al r7 r7 LSR 5 41 0x6f, 0xea, 0xa3, 0x70 // mvn al r0 r3 ASR 30 44 0x6f, 0xea, 0xe5, 0x7a // mvn al r10 r5 ASR 31 47 0x6f, 0xea, 0x29, 0x4c // mvn al r12 r9 ASR 16 50 0x6f, 0xea, 0xe3, 0x75 // mvn al r5 r3 ASR 31 53 0x6f, 0xea, 0xa8, 0x2a // mvn al r10 r8 ASR 10 56 0x6f, 0xea, 0xd7, 0x26 // mvn al r6 r7 LSR 11 59 0x6f, 0xea, 0xec, 0x7d // mvn al r13 r12 ASR 31 62 0x6f, 0xea, 0xa0, 0x54 // mvn al r4 r0 ASR 22 65 0x6f, 0xea, 0xea, 0x53 // mvn al r3 r10 ASR 23 [all …]
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D | assembler-cond-rd-operand-rn-shift-amount-1to32-teq-t32.h | 38 0x97, 0xea, 0x57, 0x1f // teq al r7 r7 LSR 5 41 0x90, 0xea, 0xa3, 0x7f // teq al r0 r3 ASR 30 44 0x9a, 0xea, 0xe5, 0x7f // teq al r10 r5 ASR 31 47 0x9c, 0xea, 0x29, 0x4f // teq al r12 r9 ASR 16 50 0x95, 0xea, 0xe3, 0x7f // teq al r5 r3 ASR 31 53 0x9a, 0xea, 0xa8, 0x2f // teq al r10 r8 ASR 10 56 0x96, 0xea, 0xd7, 0x2f // teq al r6 r7 LSR 11 59 0x9d, 0xea, 0xec, 0x7f // teq al r13 r12 ASR 31 62 0x94, 0xea, 0xa0, 0x5f // teq al r4 r0 ASR 22 65 0x93, 0xea, 0xea, 0x5f // teq al r3 r10 ASR 23 [all …]
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D | assembler-cond-rd-operand-rn-shift-amount-1to32-tst-t32.h | 38 0x17, 0xea, 0x57, 0x1f // tst al r7 r7 LSR 5 41 0x10, 0xea, 0xa3, 0x7f // tst al r0 r3 ASR 30 44 0x1a, 0xea, 0xe5, 0x7f // tst al r10 r5 ASR 31 47 0x1c, 0xea, 0x29, 0x4f // tst al r12 r9 ASR 16 50 0x15, 0xea, 0xe3, 0x7f // tst al r5 r3 ASR 31 53 0x1a, 0xea, 0xa8, 0x2f // tst al r10 r8 ASR 10 56 0x16, 0xea, 0xd7, 0x2f // tst al r6 r7 LSR 11 59 0x1d, 0xea, 0xec, 0x7f // tst al r13 r12 ASR 31 62 0x14, 0xea, 0xa0, 0x5f // tst al r4 r0 ASR 22 65 0x13, 0xea, 0xea, 0x5f // tst al r3 r10 ASR 23 [all …]
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D | assembler-cond-rd-operand-rn-shift-amount-1to32-mov-t32.h | 38 0x4f, 0xea, 0x57, 0x17 // mov al r7 r7 LSR 5 41 0x4f, 0xea, 0xa3, 0x70 // mov al r0 r3 ASR 30 44 0x4f, 0xea, 0xe5, 0x7a // mov al r10 r5 ASR 31 47 0x4f, 0xea, 0x29, 0x4c // mov al r12 r9 ASR 16 50 0x4f, 0xea, 0xe3, 0x75 // mov al r5 r3 ASR 31 53 0x4f, 0xea, 0xa8, 0x2a // mov al r10 r8 ASR 10 56 0x4f, 0xea, 0xd7, 0x26 // mov al r6 r7 LSR 11 59 0x4f, 0xea, 0xec, 0x7d // mov al r13 r12 ASR 31 62 0x4f, 0xea, 0xa0, 0x54 // mov al r4 r0 ASR 22 65 0x4f, 0xea, 0xea, 0x53 // mov al r3 r10 ASR 23 [all …]
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D | assembler-cond-rd-rn-operand-rm-shift-amount-1to32-bics-t32.h | 38 0x3d, 0xea, 0x6a, 0x2b // bics al r11 r13 r10 ASR 9 41 0x35, 0xea, 0xa2, 0x07 // bics al r7 r5 r2 ASR 2 44 0x32, 0xea, 0x5b, 0x15 // bics al r5 r2 r11 LSR 5 47 0x36, 0xea, 0x1a, 0x0e // bics al r14 r6 r10 LSR 32 50 0x36, 0xea, 0x53, 0x39 // bics al r9 r6 r3 LSR 13 53 0x34, 0xea, 0xd6, 0x7e // bics al r14 r4 r6 LSR 31 56 0x31, 0xea, 0x97, 0x32 // bics al r2 r1 r7 LSR 14 59 0x39, 0xea, 0x1c, 0x62 // bics al r2 r9 r12 LSR 24 62 0x3c, 0xea, 0xa4, 0x0a // bics al r10 r12 r4 ASR 2 65 0x3a, 0xea, 0x10, 0x26 // bics al r6 r10 r0 LSR 8 [all …]
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D | assembler-cond-rd-rn-operand-rm-shift-amount-1to32-orr-t32.h | 38 0x4d, 0xea, 0x6a, 0x2b // orr al r11 r13 r10 ASR 9 41 0x45, 0xea, 0xa2, 0x07 // orr al r7 r5 r2 ASR 2 44 0x42, 0xea, 0x5b, 0x15 // orr al r5 r2 r11 LSR 5 47 0x46, 0xea, 0x1a, 0x0e // orr al r14 r6 r10 LSR 32 50 0x46, 0xea, 0x53, 0x39 // orr al r9 r6 r3 LSR 13 53 0x44, 0xea, 0xd6, 0x7e // orr al r14 r4 r6 LSR 31 56 0x41, 0xea, 0x97, 0x32 // orr al r2 r1 r7 LSR 14 59 0x49, 0xea, 0x1c, 0x62 // orr al r2 r9 r12 LSR 24 62 0x4c, 0xea, 0xa4, 0x0a // orr al r10 r12 r4 ASR 2 65 0x4a, 0xea, 0x10, 0x26 // orr al r6 r10 r0 LSR 8 [all …]
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D | assembler-cond-rd-rn-operand-rm-shift-amount-1to32-orrs-t32.h | 38 0x5d, 0xea, 0x6a, 0x2b // orrs al r11 r13 r10 ASR 9 41 0x55, 0xea, 0xa2, 0x07 // orrs al r7 r5 r2 ASR 2 44 0x52, 0xea, 0x5b, 0x15 // orrs al r5 r2 r11 LSR 5 47 0x56, 0xea, 0x1a, 0x0e // orrs al r14 r6 r10 LSR 32 50 0x56, 0xea, 0x53, 0x39 // orrs al r9 r6 r3 LSR 13 53 0x54, 0xea, 0xd6, 0x7e // orrs al r14 r4 r6 LSR 31 56 0x51, 0xea, 0x97, 0x32 // orrs al r2 r1 r7 LSR 14 59 0x59, 0xea, 0x1c, 0x62 // orrs al r2 r9 r12 LSR 24 62 0x5c, 0xea, 0xa4, 0x0a // orrs al r10 r12 r4 ASR 2 65 0x5a, 0xea, 0x10, 0x26 // orrs al r6 r10 r0 LSR 8 [all …]
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D | assembler-cond-rd-rn-operand-rm-shift-amount-1to32-ands-t32.h | 38 0x1d, 0xea, 0x6a, 0x2b // ands al r11 r13 r10 ASR 9 41 0x15, 0xea, 0xa2, 0x07 // ands al r7 r5 r2 ASR 2 44 0x12, 0xea, 0x5b, 0x15 // ands al r5 r2 r11 LSR 5 47 0x16, 0xea, 0x1a, 0x0e // ands al r14 r6 r10 LSR 32 50 0x16, 0xea, 0x53, 0x39 // ands al r9 r6 r3 LSR 13 53 0x14, 0xea, 0xd6, 0x7e // ands al r14 r4 r6 LSR 31 56 0x11, 0xea, 0x97, 0x32 // ands al r2 r1 r7 LSR 14 59 0x19, 0xea, 0x1c, 0x62 // ands al r2 r9 r12 LSR 24 62 0x1c, 0xea, 0xa4, 0x0a // ands al r10 r12 r4 ASR 2 65 0x1a, 0xea, 0x10, 0x26 // ands al r6 r10 r0 LSR 8 [all …]
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D | assembler-cond-rd-rn-operand-rm-shift-amount-1to32-orn-t32.h | 38 0x6d, 0xea, 0x6a, 0x2b // orn al r11 r13 r10 ASR 9 41 0x65, 0xea, 0xa2, 0x07 // orn al r7 r5 r2 ASR 2 44 0x62, 0xea, 0x5b, 0x15 // orn al r5 r2 r11 LSR 5 47 0x66, 0xea, 0x1a, 0x0e // orn al r14 r6 r10 LSR 32 50 0x66, 0xea, 0x53, 0x39 // orn al r9 r6 r3 LSR 13 53 0x64, 0xea, 0xd6, 0x7e // orn al r14 r4 r6 LSR 31 56 0x61, 0xea, 0x97, 0x32 // orn al r2 r1 r7 LSR 14 59 0x69, 0xea, 0x1c, 0x62 // orn al r2 r9 r12 LSR 24 62 0x6c, 0xea, 0xa4, 0x0a // orn al r10 r12 r4 ASR 2 65 0x6a, 0xea, 0x10, 0x26 // orn al r6 r10 r0 LSR 8 [all …]
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D | assembler-cond-rd-rn-operand-rm-shift-amount-1to32-and-t32.h | 38 0x0d, 0xea, 0x6a, 0x2b // and_ al r11 r13 r10 ASR 9 41 0x05, 0xea, 0xa2, 0x07 // and_ al r7 r5 r2 ASR 2 44 0x02, 0xea, 0x5b, 0x15 // and_ al r5 r2 r11 LSR 5 47 0x06, 0xea, 0x1a, 0x0e // and_ al r14 r6 r10 LSR 32 50 0x06, 0xea, 0x53, 0x39 // and_ al r9 r6 r3 LSR 13 53 0x04, 0xea, 0xd6, 0x7e // and_ al r14 r4 r6 LSR 31 56 0x01, 0xea, 0x97, 0x32 // and_ al r2 r1 r7 LSR 14 59 0x09, 0xea, 0x1c, 0x62 // and_ al r2 r9 r12 LSR 24 62 0x0c, 0xea, 0xa4, 0x0a // and_ al r10 r12 r4 ASR 2 65 0x0a, 0xea, 0x10, 0x26 // and_ al r6 r10 r0 LSR 8 [all …]
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D | assembler-cond-rd-rn-operand-rm-shift-amount-1to32-eors-t32.h | 38 0x9d, 0xea, 0x6a, 0x2b // eors al r11 r13 r10 ASR 9 41 0x95, 0xea, 0xa2, 0x07 // eors al r7 r5 r2 ASR 2 44 0x92, 0xea, 0x5b, 0x15 // eors al r5 r2 r11 LSR 5 47 0x96, 0xea, 0x1a, 0x0e // eors al r14 r6 r10 LSR 32 50 0x96, 0xea, 0x53, 0x39 // eors al r9 r6 r3 LSR 13 53 0x94, 0xea, 0xd6, 0x7e // eors al r14 r4 r6 LSR 31 56 0x91, 0xea, 0x97, 0x32 // eors al r2 r1 r7 LSR 14 59 0x99, 0xea, 0x1c, 0x62 // eors al r2 r9 r12 LSR 24 62 0x9c, 0xea, 0xa4, 0x0a // eors al r10 r12 r4 ASR 2 65 0x9a, 0xea, 0x10, 0x26 // eors al r6 r10 r0 LSR 8 [all …]
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D | assembler-cond-rd-rn-operand-rm-shift-amount-1to32-bic-t32.h | 38 0x2d, 0xea, 0x6a, 0x2b // bic al r11 r13 r10 ASR 9 41 0x25, 0xea, 0xa2, 0x07 // bic al r7 r5 r2 ASR 2 44 0x22, 0xea, 0x5b, 0x15 // bic al r5 r2 r11 LSR 5 47 0x26, 0xea, 0x1a, 0x0e // bic al r14 r6 r10 LSR 32 50 0x26, 0xea, 0x53, 0x39 // bic al r9 r6 r3 LSR 13 53 0x24, 0xea, 0xd6, 0x7e // bic al r14 r4 r6 LSR 31 56 0x21, 0xea, 0x97, 0x32 // bic al r2 r1 r7 LSR 14 59 0x29, 0xea, 0x1c, 0x62 // bic al r2 r9 r12 LSR 24 62 0x2c, 0xea, 0xa4, 0x0a // bic al r10 r12 r4 ASR 2 65 0x2a, 0xea, 0x10, 0x26 // bic al r6 r10 r0 LSR 8 [all …]
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D | assembler-cond-rd-rn-operand-rm-shift-amount-1to32-eor-t32.h | 38 0x8d, 0xea, 0x6a, 0x2b // eor al r11 r13 r10 ASR 9 41 0x85, 0xea, 0xa2, 0x07 // eor al r7 r5 r2 ASR 2 44 0x82, 0xea, 0x5b, 0x15 // eor al r5 r2 r11 LSR 5 47 0x86, 0xea, 0x1a, 0x0e // eor al r14 r6 r10 LSR 32 50 0x86, 0xea, 0x53, 0x39 // eor al r9 r6 r3 LSR 13 53 0x84, 0xea, 0xd6, 0x7e // eor al r14 r4 r6 LSR 31 56 0x81, 0xea, 0x97, 0x32 // eor al r2 r1 r7 LSR 14 59 0x89, 0xea, 0x1c, 0x62 // eor al r2 r9 r12 LSR 24 62 0x8c, 0xea, 0xa4, 0x0a // eor al r10 r12 r4 ASR 2 65 0x8a, 0xea, 0x10, 0x26 // eor al r6 r10 r0 LSR 8 [all …]
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D | assembler-cond-rd-rn-operand-rm-shift-amount-1to32-orns-t32.h | 38 0x7d, 0xea, 0x6a, 0x2b // orns al r11 r13 r10 ASR 9 41 0x75, 0xea, 0xa2, 0x07 // orns al r7 r5 r2 ASR 2 44 0x72, 0xea, 0x5b, 0x15 // orns al r5 r2 r11 LSR 5 47 0x76, 0xea, 0x1a, 0x0e // orns al r14 r6 r10 LSR 32 50 0x76, 0xea, 0x53, 0x39 // orns al r9 r6 r3 LSR 13 53 0x74, 0xea, 0xd6, 0x7e // orns al r14 r4 r6 LSR 31 56 0x71, 0xea, 0x97, 0x32 // orns al r2 r1 r7 LSR 14 59 0x79, 0xea, 0x1c, 0x62 // orns al r2 r9 r12 LSR 24 62 0x7c, 0xea, 0xa4, 0x0a // orns al r10 r12 r4 ASR 2 65 0x7a, 0xea, 0x10, 0x26 // orns al r6 r10 r0 LSR 8 [all …]
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D | assembler-cond-rd-rn-operand-rm-orn-t32.h | 38 0x69, 0xea, 0x0b, 0x0c // orn al r12 r9 r11 41 0x64, 0xea, 0x0a, 0x03 // orn al r3 r4 r10 44 0x60, 0xea, 0x0c, 0x02 // orn al r2 r0 r12 47 0x69, 0xea, 0x0d, 0x09 // orn al r9 r9 r13 50 0x62, 0xea, 0x04, 0x0b // orn al r11 r2 r4 53 0x63, 0xea, 0x07, 0x07 // orn al r7 r3 r7 56 0x66, 0xea, 0x09, 0x0b // orn al r11 r6 r9 59 0x67, 0xea, 0x0b, 0x08 // orn al r8 r7 r11 62 0x6c, 0xea, 0x0e, 0x0e // orn al r14 r12 r14 65 0x65, 0xea, 0x08, 0x08 // orn al r8 r5 r8 [all …]
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D | assembler-cond-rd-rn-operand-rm-shift-amount-1to31-ands-t32.h | 38 0x14, 0xea, 0xc7, 0x1c // ands al r12 r4 r7 LSL 7 41 0x18, 0xea, 0x7a, 0x57 // ands al r7 r8 r10 ROR 21 44 0x15, 0xea, 0x33, 0x35 // ands al r5 r5 r3 ROR 12 47 0x1d, 0xea, 0x8a, 0x5e // ands al r14 r13 r10 LSL 22 50 0x1a, 0xea, 0xbb, 0x09 // ands al r9 r10 r11 ROR 2 53 0x1b, 0xea, 0xc5, 0x3e // ands al r14 r11 r5 LSL 15 56 0x12, 0xea, 0x07, 0x72 // ands al r2 r2 r7 LSL 28 59 0x1b, 0xea, 0x71, 0x22 // ands al r2 r11 r1 ROR 9 62 0x12, 0xea, 0x08, 0x1b // ands al r11 r2 r8 LSL 4 65 0x1d, 0xea, 0x73, 0x06 // ands al r6 r13 r3 ROR 1 [all …]
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D | assembler-cond-rd-rn-operand-rm-and-t32.h | 38 0x09, 0xea, 0x0b, 0x0c // and_ al r12 r9 r11 41 0x04, 0xea, 0x0a, 0x03 // and_ al r3 r4 r10 44 0x00, 0xea, 0x0c, 0x02 // and_ al r2 r0 r12 47 0x09, 0xea, 0x0d, 0x09 // and_ al r9 r9 r13 50 0x02, 0xea, 0x04, 0x0b // and_ al r11 r2 r4 53 0x03, 0xea, 0x07, 0x07 // and_ al r7 r3 r7 56 0x06, 0xea, 0x09, 0x0b // and_ al r11 r6 r9 59 0x07, 0xea, 0x0b, 0x08 // and_ al r8 r7 r11 62 0x0c, 0xea, 0x0e, 0x0e // and_ al r14 r12 r14 65 0x05, 0xea, 0x08, 0x08 // and_ al r8 r5 r8 [all …]
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D | assembler-cond-rd-rn-operand-rm-shift-amount-1to31-bics-t32.h | 38 0x34, 0xea, 0xc7, 0x1c // bics al r12 r4 r7 LSL 7 41 0x38, 0xea, 0x7a, 0x57 // bics al r7 r8 r10 ROR 21 44 0x35, 0xea, 0x33, 0x35 // bics al r5 r5 r3 ROR 12 47 0x3d, 0xea, 0x8a, 0x5e // bics al r14 r13 r10 LSL 22 50 0x3a, 0xea, 0xbb, 0x09 // bics al r9 r10 r11 ROR 2 53 0x3b, 0xea, 0xc5, 0x3e // bics al r14 r11 r5 LSL 15 56 0x32, 0xea, 0x07, 0x72 // bics al r2 r2 r7 LSL 28 59 0x3b, 0xea, 0x71, 0x22 // bics al r2 r11 r1 ROR 9 62 0x32, 0xea, 0x08, 0x1b // bics al r11 r2 r8 LSL 4 65 0x3d, 0xea, 0x73, 0x06 // bics al r6 r13 r3 ROR 1 [all …]
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D | assembler-cond-rd-rn-operand-rm-shift-amount-1to31-and-t32.h | 38 0x04, 0xea, 0xc7, 0x1c // and_ al r12 r4 r7 LSL 7 41 0x08, 0xea, 0x7a, 0x57 // and_ al r7 r8 r10 ROR 21 44 0x05, 0xea, 0x33, 0x35 // and_ al r5 r5 r3 ROR 12 47 0x0d, 0xea, 0x8a, 0x5e // and_ al r14 r13 r10 LSL 22 50 0x0a, 0xea, 0xbb, 0x09 // and_ al r9 r10 r11 ROR 2 53 0x0b, 0xea, 0xc5, 0x3e // and_ al r14 r11 r5 LSL 15 56 0x02, 0xea, 0x07, 0x72 // and_ al r2 r2 r7 LSL 28 59 0x0b, 0xea, 0x71, 0x22 // and_ al r2 r11 r1 ROR 9 62 0x02, 0xea, 0x08, 0x1b // and_ al r11 r2 r8 LSL 4 65 0x0d, 0xea, 0x73, 0x06 // and_ al r6 r13 r3 ROR 1 [all …]
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