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Searched refs:d1 (Results 1 – 12 of 12) sorted by relevance

/art/test/705-register-conflict/src/
DMain.java28 double d0 = 0, d1 = 0, d2 = 0, d3 = 0, d4 = 0, d5 = 0, d6 = 0, d7 = 0; in $opt$registerConflictTest() local
34 d1 = d0 + 1; in $opt$registerConflictTest()
35 d2 = d1 + 1; in $opt$registerConflictTest()
68 return d0 + d1 + d2 + d3 + d4 + d5 + d6 + d7 in $opt$registerConflictTest()
/art/runtime/arch/arm64/
Djni_entrypoints_arm64.S32 stp d0, d1, [sp, #-16]!
46 ldp d0, d1, [sp], #16
Dquick_entrypoints_arm64.S210 stp d0, d1, [sp, #8]
300 ldp d0, d1, [sp, #8]
805 LOADREG x15 8 d1 .LfillRegisters
930 LOADREG x15 8 d1 .LfillRegisters2
953 ldp d0, d1, [x1], #16
1592 ldp d0, d1, [sp, #64]
/art/test/703-floating-point-div/src/
DMain.java35 double d1 = 0x1.0p1023; in divDoubleTest() local
46 expectEquals(Double.doubleToRawLongBits(dPi/d1), 0x1921fb54442d18L); in divDoubleTest()
/art/test/080-oom-throw/src/
DMain.java40 double d1, d2, d3, d4, d5, d6, d7, d8; // Bloat this object so we fill the heap faster. field in Main.InstanceMemEater
/art/compiler/optimizing/
Dcode_generator_arm64.h43 vixl::d0, vixl::d1, vixl::d2, vixl::d3, vixl::d4, vixl::d5, vixl::d6, vixl::d7
85 { vixl::d0, vixl::d1, vixl::d2, vixl::d3, vixl::d4, vixl::d5, vixl::d6, vixl::d7 };
/art/test/800-smali/smali/
Db_22881413.smali17 .field private static unres1:La/b/c/d1;
204 sget-object v0, LB22881413;->unres1:La/b/c/d1;
/art/test/700-LoadArgRegs/src/
DMain.java273 …static void testMore(int i1, double d1, double d2, double d3, double d4, double d5, double d6, dou… in testMore() argument
274 …System.out.println(i1+", "+d1+", "+d2+", "+d3+", "+d4+", "+d5+", "+d6+", "+d7+", "+d8+", "+d9+", "… in testMore()
/art/compiler/utils/
Dassembler_thumb_test_expected.cc.inc421 " 4: eeb7 1b00 vmov.f64 d1, #112 ; 0x70\n",
423 " c: eeb0 1b42 vmov.f64 d1, d2\n",
436 " 24: ee31 0b02 vadd.f64 d0, d1, d2\n",
437 " 28: ee31 0b42 vsub.f64 d0, d1, d2\n",
438 " 2c: ee21 0b02 vmul.f64 d0, d1, d2\n",
439 " 30: ee01 0b02 vmla.f64 d0, d1, d2\n",
440 " 34: ee01 0b42 vmls.f64 d0, d1, d2\n",
441 " 38: ee81 0b02 vdiv.f64 d0, d1, d2\n",
442 " 3c: eeb0 0bc1 vabs.f64 d0, d1\n",
443 " 40: eeb1 0b41 vneg.f64 d0, d1\n",
[all …]
/art/test/083-compiler-regressions/src/
DMain.java107 double d1 = 1.0; in b17411468() local
108 double d2 = Math.round(d1); in b17411468()
109 if (d1 == d2) { in b17411468()
112 System.out.println("b17411468 fails: Math.round(" + d1 + ") returned " + d2); in b17411468()
5341 double d1 = 1; in largeFrameFloat() local
7339 d1 = d0; in largeFrameFloat()
7341 d2 = d1; in largeFrameFloat()
/art/runtime/arch/arm/
Dquick_entrypoints_arm.S1446 vmov r2, r3, d1
/art/compiler/utils/arm64/
Dmanaged_register_arm64_test.cc672 EXPECT_TRUE(vixl::d1.Is(Arm64Assembler::reg_d(D1))); in TEST()